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« Méthodologie de prototypage rapide des MPSoC sur des plateformes reconfigurables ».

Auteur : B. Senouci
Directeur de thèse : F. Pétrot
Co-directeur de thèse : F. Rousseau
Président du jury : B. Goossens
Rapporteur(s) de thèse : E. Bourennane, G. Gogniat,
These de Doctorat Grenoble INP
Spécialité : micro et nano électronique
Soutenance : 28/11/2008
ISBN : 978-2-84813-126-9

Résumé

Le besoin d’une méthodologie rapide et efficace pour la validation et le prototypage des systèmes MPSoC devient une priorité pour le monde industriel (délai de mise sur le marché), et celui de la recherche (pour une large exploration des solutions potentielles). Dans ce contexte, l’utilisation des plateformes matérielles reconfigurables pour l’accélération du prototypage des MPSoC, et la validation du logiciel embarqué est une approche très largement adoptée. Dans ce travail nous nous sommes intéressé à l’utilisation de ces plateformes matérielles pour accélérer cette phase de prototypage et de validation. La contribution de cette thèse s’agit d’une méthodologie de structuration pour les architectures MPSoC, et du flot de prototypage associé pour une validation rapide. Nous nous sommes intéressés aussi bien aux architectures homogènes qu’aux architectures hétérogènes. On a également présenté dans cette thèse un outil d’exploration logiciel semi-systématique avec un algorithme heuristique pour le «mapping» des tâches du logiciel applicatif sur des architectures hétérogènes, avec un raffinement logiciel/matériel automatiquement de la communication et de synchronisation entre processeurs hétérogènes. Enfin, des expériences et des résultats ont été présentés à travers le prototypage de l’application M-JPEG sur une configuration symétrique (plateforme ARM Integrator) et une autre configuration hétérogènes (plateforme Virtex II Pro, avec une architecture basée sur deux processeurs différents PowerPC et Microblaze).